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drm/amdgpu: add navi10 ip offset header
Signed-off-by: Hawking Zhang <Hawking.Zhang@amd.com> Signed-off-by: Alex Deucher <alexander.deucher@amd.com>
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855
drivers/gpu/drm/amd/include/navi10_ip_offset.h
Normal file
855
drivers/gpu/drm/amd/include/navi10_ip_offset.h
Normal file
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@ -0,0 +1,855 @@
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/*
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* Copyright (C) 2019 Advanced Micro Devices, Inc.
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* copy of this software and associated documentation files (the "Software"),
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* AN ACTION OF CONTRACT, TORT OR OTHERWISE, ARISING FROM, OUT OF OR IN
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||||
* CONNECTION WITH THE SOFTWARE OR THE USE OR OTHER DEALINGS IN THE SOFTWARE.
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*/
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#ifndef _navi10_ip_offset_HEADER
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#define _navi10_ip_offset_HEADER
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||||
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#define MAX_INSTANCE 6
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||||
#define MAX_SEGMENT 6
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||||
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||||
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||||
struct IP_BASE_INSTANCE {
|
||||
unsigned int segment[MAX_SEGMENT];
|
||||
};
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struct IP_BASE {
|
||||
struct IP_BASE_INSTANCE instance[MAX_INSTANCE];
|
||||
};
|
||||
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||||
static const struct IP_BASE ATHUB_BASE ={ { { { 0x00000C00, 0, 0, 0, 0, 0 } },
|
||||
{ { 0, 0, 0, 0, 0, 0 } },
|
||||
{ { 0, 0, 0, 0, 0, 0 } },
|
||||
{ { 0, 0, 0, 0, 0, 0 } },
|
||||
{ { 0, 0, 0, 0, 0, 0 } },
|
||||
{ { 0, 0, 0, 0, 0, 0 } } } };
|
||||
static const struct IP_BASE CLK_BASE ={ { { { 0x00016C00, 0x00016E00, 0x00017000, 0x00017200, 0x00017E00, 0x0001B000 } },
|
||||
{ { 0, 0, 0, 0, 0, 0 } },
|
||||
{ { 0, 0, 0, 0, 0, 0 } },
|
||||
{ { 0, 0, 0, 0, 0, 0 } },
|
||||
{ { 0, 0, 0, 0, 0, 0 } },
|
||||
{ { 0, 0, 0, 0, 0, 0 } } } };
|
||||
static const struct IP_BASE DF_BASE ={ { { { 0x00007000, 0, 0, 0, 0, 0 } },
|
||||
{ { 0, 0, 0, 0, 0, 0 } },
|
||||
{ { 0, 0, 0, 0, 0, 0 } },
|
||||
{ { 0, 0, 0, 0, 0, 0 } },
|
||||
{ { 0, 0, 0, 0, 0, 0 } },
|
||||
{ { 0, 0, 0, 0, 0, 0 } } } };
|
||||
static const struct IP_BASE DCN_BASE ={ { { { 0x00000012, 0x000000C0, 0x000034C0, 0x00009000, 0, 0 } },
|
||||
{ { 0, 0, 0, 0, 0, 0 } },
|
||||
{ { 0, 0, 0, 0, 0, 0 } },
|
||||
{ { 0, 0, 0, 0, 0, 0 } },
|
||||
{ { 0, 0, 0, 0, 0, 0 } },
|
||||
{ { 0, 0, 0, 0, 0, 0 } } } };
|
||||
static const struct IP_BASE FUSE_BASE ={ { { { 0x00017400, 0, 0, 0, 0, 0 } },
|
||||
{ { 0, 0, 0, 0, 0, 0 } },
|
||||
{ { 0, 0, 0, 0, 0, 0 } },
|
||||
{ { 0, 0, 0, 0, 0, 0 } },
|
||||
{ { 0, 0, 0, 0, 0, 0 } },
|
||||
{ { 0, 0, 0, 0, 0, 0 } } } };
|
||||
static const struct IP_BASE GC_BASE ={ { { { 0x00001260, 0x0000A000, 0, 0, 0, 0 } },
|
||||
{ { 0, 0, 0, 0, 0, 0 } },
|
||||
{ { 0, 0, 0, 0, 0, 0 } },
|
||||
{ { 0, 0, 0, 0, 0, 0 } },
|
||||
{ { 0, 0, 0, 0, 0, 0 } },
|
||||
{ { 0, 0, 0, 0, 0, 0 } } } };
|
||||
static const struct IP_BASE HDP_BASE ={ { { { 0x00000F20, 0, 0, 0, 0, 0 } },
|
||||
{ { 0, 0, 0, 0, 0, 0 } },
|
||||
{ { 0, 0, 0, 0, 0, 0 } },
|
||||
{ { 0, 0, 0, 0, 0, 0 } },
|
||||
{ { 0, 0, 0, 0, 0, 0 } },
|
||||
{ { 0, 0, 0, 0, 0, 0 } } } };
|
||||
static const struct IP_BASE MMHUB_BASE ={ { { { 0x0001A000, 0, 0, 0, 0, 0 } },
|
||||
{ { 0, 0, 0, 0, 0, 0 } },
|
||||
{ { 0, 0, 0, 0, 0, 0 } },
|
||||
{ { 0, 0, 0, 0, 0, 0 } },
|
||||
{ { 0, 0, 0, 0, 0, 0 } },
|
||||
{ { 0, 0, 0, 0, 0, 0 } } } };
|
||||
static const struct IP_BASE MP0_BASE ={ { { { 0x00016000, 0, 0, 0, 0, 0 } },
|
||||
{ { 0, 0, 0, 0, 0, 0 } },
|
||||
{ { 0, 0, 0, 0, 0, 0 } },
|
||||
{ { 0, 0, 0, 0, 0, 0 } },
|
||||
{ { 0, 0, 0, 0, 0, 0 } },
|
||||
{ { 0, 0, 0, 0, 0, 0 } } } };
|
||||
static const struct IP_BASE MP1_BASE ={ { { { 0x00016000, 0, 0, 0, 0, 0 } },
|
||||
{ { 0, 0, 0, 0, 0, 0 } },
|
||||
{ { 0, 0, 0, 0, 0, 0 } },
|
||||
{ { 0, 0, 0, 0, 0, 0 } },
|
||||
{ { 0, 0, 0, 0, 0, 0 } },
|
||||
{ { 0, 0, 0, 0, 0, 0 } } } };
|
||||
static const struct IP_BASE NBIO_BASE ={ { { { 0x00000000, 0x00000014, 0x00000D20, 0x00010400, 0, 0 } },
|
||||
{ { 0, 0, 0, 0, 0, 0 } },
|
||||
{ { 0, 0, 0, 0, 0, 0 } },
|
||||
{ { 0, 0, 0, 0, 0, 0 } },
|
||||
{ { 0, 0, 0, 0, 0, 0 } },
|
||||
{ { 0, 0, 0, 0, 0, 0 } } } };
|
||||
static const struct IP_BASE OSSSYS_BASE ={ { { { 0x000010A0, 0, 0, 0, 0, 0 } },
|
||||
{ { 0, 0, 0, 0, 0, 0 } },
|
||||
{ { 0, 0, 0, 0, 0, 0 } },
|
||||
{ { 0, 0, 0, 0, 0, 0 } },
|
||||
{ { 0, 0, 0, 0, 0, 0 } },
|
||||
{ { 0, 0, 0, 0, 0, 0 } } } };
|
||||
static const struct IP_BASE RSMU_BASE = { { { { 0x00012000, 0, 0, 0, 0, 0 } },
|
||||
{ { 0, 0, 0, 0, 0, 0 } },
|
||||
{ { 0, 0, 0, 0, 0, 0 } },
|
||||
{ { 0, 0, 0, 0, 0, 0 } },
|
||||
{ { 0, 0, 0, 0, 0, 0 } },
|
||||
{ { 0, 0, 0, 0, 0, 0 } } } };
|
||||
static const struct IP_BASE SMUIO_BASE ={ { { { 0x00016800, 0x00016A00, 0, 0, 0, 0 } },
|
||||
{ { 0, 0, 0, 0, 0, 0 } },
|
||||
{ { 0, 0, 0, 0, 0, 0 } },
|
||||
{ { 0, 0, 0, 0, 0, 0 } },
|
||||
{ { 0, 0, 0, 0, 0, 0 } },
|
||||
{ { 0, 0, 0, 0, 0, 0 } } } };
|
||||
static const struct IP_BASE THM_BASE ={ { { { 0x00016600, 0, 0, 0, 0, 0 } },
|
||||
{ { 0, 0, 0, 0, 0, 0 } },
|
||||
{ { 0, 0, 0, 0, 0, 0 } },
|
||||
{ { 0, 0, 0, 0, 0, 0 } },
|
||||
{ { 0, 0, 0, 0, 0, 0 } },
|
||||
{ { 0, 0, 0, 0, 0, 0 } } } };
|
||||
static const struct IP_BASE UMC_BASE ={ { { { 0x00014000, 0, 0, 0, 0, 0 } },
|
||||
{ { 0, 0, 0, 0, 0, 0 } },
|
||||
{ { 0, 0, 0, 0, 0, 0 } },
|
||||
{ { 0, 0, 0, 0, 0, 0 } },
|
||||
{ { 0, 0, 0, 0, 0, 0 } },
|
||||
{ { 0, 0, 0, 0, 0, 0 } } } };
|
||||
static const struct IP_BASE VCN_BASE ={ { { { 0x00007800, 0x00007E00, 0, 0, 0, 0 } },
|
||||
{ { 0, 0, 0, 0, 0, 0 } },
|
||||
{ { 0, 0, 0, 0, 0, 0 } },
|
||||
{ { 0, 0, 0, 0, 0, 0 } },
|
||||
{ { 0, 0, 0, 0, 0, 0 } },
|
||||
{ { 0, 0, 0, 0, 0, 0 } } } };
|
||||
|
||||
|
||||
#define ATHUB_BASE__INST0_SEG0 0x00000C00
|
||||
#define ATHUB_BASE__INST0_SEG1 0
|
||||
#define ATHUB_BASE__INST0_SEG2 0
|
||||
#define ATHUB_BASE__INST0_SEG3 0
|
||||
#define ATHUB_BASE__INST0_SEG4 0
|
||||
#define ATHUB_BASE__INST0_SEG5 0
|
||||
|
||||
#define ATHUB_BASE__INST1_SEG0 0
|
||||
#define ATHUB_BASE__INST1_SEG1 0
|
||||
#define ATHUB_BASE__INST1_SEG2 0
|
||||
#define ATHUB_BASE__INST1_SEG3 0
|
||||
#define ATHUB_BASE__INST1_SEG4 0
|
||||
#define ATHUB_BASE__INST1_SEG5 0
|
||||
|
||||
#define ATHUB_BASE__INST2_SEG0 0
|
||||
#define ATHUB_BASE__INST2_SEG1 0
|
||||
#define ATHUB_BASE__INST2_SEG2 0
|
||||
#define ATHUB_BASE__INST2_SEG3 0
|
||||
#define ATHUB_BASE__INST2_SEG4 0
|
||||
#define ATHUB_BASE__INST2_SEG5 0
|
||||
|
||||
#define ATHUB_BASE__INST3_SEG0 0
|
||||
#define ATHUB_BASE__INST3_SEG1 0
|
||||
#define ATHUB_BASE__INST3_SEG2 0
|
||||
#define ATHUB_BASE__INST3_SEG3 0
|
||||
#define ATHUB_BASE__INST3_SEG4 0
|
||||
#define ATHUB_BASE__INST3_SEG5 0
|
||||
|
||||
#define ATHUB_BASE__INST4_SEG0 0
|
||||
#define ATHUB_BASE__INST4_SEG1 0
|
||||
#define ATHUB_BASE__INST4_SEG2 0
|
||||
#define ATHUB_BASE__INST4_SEG3 0
|
||||
#define ATHUB_BASE__INST4_SEG4 0
|
||||
#define ATHUB_BASE__INST4_SEG5 0
|
||||
|
||||
#define ATHUB_BASE__INST5_SEG0 0
|
||||
#define ATHUB_BASE__INST5_SEG1 0
|
||||
#define ATHUB_BASE__INST5_SEG2 0
|
||||
#define ATHUB_BASE__INST5_SEG3 0
|
||||
#define ATHUB_BASE__INST5_SEG4 0
|
||||
#define ATHUB_BASE__INST5_SEG5 0
|
||||
|
||||
#define CLK_BASE__INST0_SEG0 0x00016C00
|
||||
#define CLK_BASE__INST0_SEG1 0x00016E00
|
||||
#define CLK_BASE__INST0_SEG2 0x00017000
|
||||
#define CLK_BASE__INST0_SEG3 0x00017200
|
||||
#define CLK_BASE__INST0_SEG4 0x00017E00
|
||||
#define CLK_BASE__INST0_SEG5 0x0001B000
|
||||
|
||||
#define CLK_BASE__INST1_SEG0 0
|
||||
#define CLK_BASE__INST1_SEG1 0
|
||||
#define CLK_BASE__INST1_SEG2 0
|
||||
#define CLK_BASE__INST1_SEG3 0
|
||||
#define CLK_BASE__INST1_SEG4 0
|
||||
#define CLK_BASE__INST1_SEG5 0
|
||||
|
||||
#define CLK_BASE__INST2_SEG0 0
|
||||
#define CLK_BASE__INST2_SEG1 0
|
||||
#define CLK_BASE__INST2_SEG2 0
|
||||
#define CLK_BASE__INST2_SEG3 0
|
||||
#define CLK_BASE__INST2_SEG4 0
|
||||
#define CLK_BASE__INST2_SEG5 0
|
||||
|
||||
#define CLK_BASE__INST3_SEG0 0
|
||||
#define CLK_BASE__INST3_SEG1 0
|
||||
#define CLK_BASE__INST3_SEG2 0
|
||||
#define CLK_BASE__INST3_SEG3 0
|
||||
#define CLK_BASE__INST3_SEG4 0
|
||||
#define CLK_BASE__INST3_SEG5 0
|
||||
|
||||
#define CLK_BASE__INST4_SEG0 0
|
||||
#define CLK_BASE__INST4_SEG1 0
|
||||
#define CLK_BASE__INST4_SEG2 0
|
||||
#define CLK_BASE__INST4_SEG3 0
|
||||
#define CLK_BASE__INST4_SEG4 0
|
||||
#define CLK_BASE__INST4_SEG5 0
|
||||
|
||||
#define CLK_BASE__INST5_SEG0 0
|
||||
#define CLK_BASE__INST5_SEG1 0
|
||||
#define CLK_BASE__INST5_SEG2 0
|
||||
#define CLK_BASE__INST5_SEG3 0
|
||||
#define CLK_BASE__INST5_SEG4 0
|
||||
#define CLK_BASE__INST5_SEG5 0
|
||||
|
||||
#define DF_BASE__INST0_SEG0 0x00007000
|
||||
#define DF_BASE__INST0_SEG1 0
|
||||
#define DF_BASE__INST0_SEG2 0
|
||||
#define DF_BASE__INST0_SEG3 0
|
||||
#define DF_BASE__INST0_SEG4 0
|
||||
#define DF_BASE__INST0_SEG5 0
|
||||
|
||||
#define DF_BASE__INST1_SEG0 0
|
||||
#define DF_BASE__INST1_SEG1 0
|
||||
#define DF_BASE__INST1_SEG2 0
|
||||
#define DF_BASE__INST1_SEG3 0
|
||||
#define DF_BASE__INST1_SEG4 0
|
||||
#define DF_BASE__INST1_SEG5 0
|
||||
|
||||
#define DF_BASE__INST2_SEG0 0
|
||||
#define DF_BASE__INST2_SEG1 0
|
||||
#define DF_BASE__INST2_SEG2 0
|
||||
#define DF_BASE__INST2_SEG3 0
|
||||
#define DF_BASE__INST2_SEG4 0
|
||||
#define DF_BASE__INST2_SEG5 0
|
||||
|
||||
#define DF_BASE__INST3_SEG0 0
|
||||
#define DF_BASE__INST3_SEG1 0
|
||||
#define DF_BASE__INST3_SEG2 0
|
||||
#define DF_BASE__INST3_SEG3 0
|
||||
#define DF_BASE__INST3_SEG4 0
|
||||
#define DF_BASE__INST3_SEG5 0
|
||||
|
||||
#define DF_BASE__INST4_SEG0 0
|
||||
#define DF_BASE__INST4_SEG1 0
|
||||
#define DF_BASE__INST4_SEG2 0
|
||||
#define DF_BASE__INST4_SEG3 0
|
||||
#define DF_BASE__INST4_SEG4 0
|
||||
#define DF_BASE__INST4_SEG5 0
|
||||
|
||||
#define DF_BASE__INST5_SEG0 0
|
||||
#define DF_BASE__INST5_SEG1 0
|
||||
#define DF_BASE__INST5_SEG2 0
|
||||
#define DF_BASE__INST5_SEG3 0
|
||||
#define DF_BASE__INST5_SEG4 0
|
||||
#define DF_BASE__INST5_SEG5 0
|
||||
|
||||
#define DCN_BASE__INST0_SEG0 0x00000012
|
||||
#define DCN_BASE__INST0_SEG1 0x000000C0
|
||||
#define DCN_BASE__INST0_SEG2 0x000034C0
|
||||
#define DCN_BASE__INST0_SEG3 0x00009000
|
||||
#define DCN_BASE__INST0_SEG4 0
|
||||
#define DCN_BASE__INST0_SEG5 0
|
||||
|
||||
#define DCN_BASE__INST1_SEG0 0
|
||||
#define DCN_BASE__INST1_SEG1 0
|
||||
#define DCN_BASE__INST1_SEG2 0
|
||||
#define DCN_BASE__INST1_SEG3 0
|
||||
#define DCN_BASE__INST1_SEG4 0
|
||||
#define DCN_BASE__INST1_SEG5 0
|
||||
|
||||
#define DCN_BASE__INST2_SEG0 0
|
||||
#define DCN_BASE__INST2_SEG1 0
|
||||
#define DCN_BASE__INST2_SEG2 0
|
||||
#define DCN_BASE__INST2_SEG3 0
|
||||
#define DCN_BASE__INST2_SEG4 0
|
||||
#define DCN_BASE__INST2_SEG5 0
|
||||
|
||||
#define DCN_BASE__INST3_SEG0 0
|
||||
#define DCN_BASE__INST3_SEG1 0
|
||||
#define DCN_BASE__INST3_SEG2 0
|
||||
#define DCN_BASE__INST3_SEG3 0
|
||||
#define DCN_BASE__INST3_SEG4 0
|
||||
#define DCN_BASE__INST3_SEG5 0
|
||||
|
||||
#define DCN_BASE__INST4_SEG0 0
|
||||
#define DCN_BASE__INST4_SEG1 0
|
||||
#define DCN_BASE__INST4_SEG2 0
|
||||
#define DCN_BASE__INST4_SEG3 0
|
||||
#define DCN_BASE__INST4_SEG4 0
|
||||
#define DCN_BASE__INST4_SEG5 0
|
||||
|
||||
#define DCN_BASE__INST5_SEG0 0
|
||||
#define DCN_BASE__INST5_SEG1 0
|
||||
#define DCN_BASE__INST5_SEG2 0
|
||||
#define DCN_BASE__INST5_SEG3 0
|
||||
#define DCN_BASE__INST5_SEG4 0
|
||||
#define DCN_BASE__INST5_SEG5 0
|
||||
|
||||
#define FUSE_BASE__INST0_SEG0 0x00017400
|
||||
#define FUSE_BASE__INST0_SEG1 0
|
||||
#define FUSE_BASE__INST0_SEG2 0
|
||||
#define FUSE_BASE__INST0_SEG3 0
|
||||
#define FUSE_BASE__INST0_SEG4 0
|
||||
#define FUSE_BASE__INST0_SEG5 0
|
||||
|
||||
#define FUSE_BASE__INST1_SEG0 0
|
||||
#define FUSE_BASE__INST1_SEG1 0
|
||||
#define FUSE_BASE__INST1_SEG2 0
|
||||
#define FUSE_BASE__INST1_SEG3 0
|
||||
#define FUSE_BASE__INST1_SEG4 0
|
||||
#define FUSE_BASE__INST1_SEG5 0
|
||||
|
||||
#define FUSE_BASE__INST2_SEG0 0
|
||||
#define FUSE_BASE__INST2_SEG1 0
|
||||
#define FUSE_BASE__INST2_SEG2 0
|
||||
#define FUSE_BASE__INST2_SEG3 0
|
||||
#define FUSE_BASE__INST2_SEG4 0
|
||||
#define FUSE_BASE__INST2_SEG5 0
|
||||
|
||||
#define FUSE_BASE__INST3_SEG0 0
|
||||
#define FUSE_BASE__INST3_SEG1 0
|
||||
#define FUSE_BASE__INST3_SEG2 0
|
||||
#define FUSE_BASE__INST3_SEG3 0
|
||||
#define FUSE_BASE__INST3_SEG4 0
|
||||
#define FUSE_BASE__INST3_SEG5 0
|
||||
|
||||
#define FUSE_BASE__INST4_SEG0 0
|
||||
#define FUSE_BASE__INST4_SEG1 0
|
||||
#define FUSE_BASE__INST4_SEG2 0
|
||||
#define FUSE_BASE__INST4_SEG3 0
|
||||
#define FUSE_BASE__INST4_SEG4 0
|
||||
#define FUSE_BASE__INST4_SEG5 0
|
||||
|
||||
#define FUSE_BASE__INST5_SEG0 0
|
||||
#define FUSE_BASE__INST5_SEG1 0
|
||||
#define FUSE_BASE__INST5_SEG2 0
|
||||
#define FUSE_BASE__INST5_SEG3 0
|
||||
#define FUSE_BASE__INST5_SEG4 0
|
||||
#define FUSE_BASE__INST5_SEG5 0
|
||||
|
||||
#define GC_BASE__INST0_SEG0 0x00001260
|
||||
#define GC_BASE__INST0_SEG1 0x0000A000
|
||||
#define GC_BASE__INST0_SEG2 0
|
||||
#define GC_BASE__INST0_SEG3 0
|
||||
#define GC_BASE__INST0_SEG4 0
|
||||
#define GC_BASE__INST0_SEG5 0
|
||||
|
||||
#define GC_BASE__INST1_SEG0 0
|
||||
#define GC_BASE__INST1_SEG1 0
|
||||
#define GC_BASE__INST1_SEG2 0
|
||||
#define GC_BASE__INST1_SEG3 0
|
||||
#define GC_BASE__INST1_SEG4 0
|
||||
#define GC_BASE__INST1_SEG5 0
|
||||
|
||||
#define GC_BASE__INST2_SEG0 0
|
||||
#define GC_BASE__INST2_SEG1 0
|
||||
#define GC_BASE__INST2_SEG2 0
|
||||
#define GC_BASE__INST2_SEG3 0
|
||||
#define GC_BASE__INST2_SEG4 0
|
||||
#define GC_BASE__INST2_SEG5 0
|
||||
|
||||
#define GC_BASE__INST3_SEG0 0
|
||||
#define GC_BASE__INST3_SEG1 0
|
||||
#define GC_BASE__INST3_SEG2 0
|
||||
#define GC_BASE__INST3_SEG3 0
|
||||
#define GC_BASE__INST3_SEG4 0
|
||||
#define GC_BASE__INST3_SEG5 0
|
||||
|
||||
#define GC_BASE__INST4_SEG0 0
|
||||
#define GC_BASE__INST4_SEG1 0
|
||||
#define GC_BASE__INST4_SEG2 0
|
||||
#define GC_BASE__INST4_SEG3 0
|
||||
#define GC_BASE__INST4_SEG4 0
|
||||
#define GC_BASE__INST4_SEG5 0
|
||||
|
||||
#define GC_BASE__INST5_SEG0 0
|
||||
#define GC_BASE__INST5_SEG1 0
|
||||
#define GC_BASE__INST5_SEG2 0
|
||||
#define GC_BASE__INST5_SEG3 0
|
||||
#define GC_BASE__INST5_SEG4 0
|
||||
#define GC_BASE__INST5_SEG5 0
|
||||
|
||||
#define HDP_BASE__INST0_SEG0 0x00000F20
|
||||
#define HDP_BASE__INST0_SEG1 0
|
||||
#define HDP_BASE__INST0_SEG2 0
|
||||
#define HDP_BASE__INST0_SEG3 0
|
||||
#define HDP_BASE__INST0_SEG4 0
|
||||
#define HDP_BASE__INST0_SEG5 0
|
||||
|
||||
#define HDP_BASE__INST1_SEG0 0
|
||||
#define HDP_BASE__INST1_SEG1 0
|
||||
#define HDP_BASE__INST1_SEG2 0
|
||||
#define HDP_BASE__INST1_SEG3 0
|
||||
#define HDP_BASE__INST1_SEG4 0
|
||||
#define HDP_BASE__INST1_SEG5 0
|
||||
|
||||
#define HDP_BASE__INST2_SEG0 0
|
||||
#define HDP_BASE__INST2_SEG1 0
|
||||
#define HDP_BASE__INST2_SEG2 0
|
||||
#define HDP_BASE__INST2_SEG3 0
|
||||
#define HDP_BASE__INST2_SEG4 0
|
||||
#define HDP_BASE__INST2_SEG5 0
|
||||
|
||||
#define HDP_BASE__INST3_SEG0 0
|
||||
#define HDP_BASE__INST3_SEG1 0
|
||||
#define HDP_BASE__INST3_SEG2 0
|
||||
#define HDP_BASE__INST3_SEG3 0
|
||||
#define HDP_BASE__INST3_SEG4 0
|
||||
#define HDP_BASE__INST3_SEG5 0
|
||||
|
||||
#define HDP_BASE__INST4_SEG0 0
|
||||
#define HDP_BASE__INST4_SEG1 0
|
||||
#define HDP_BASE__INST4_SEG2 0
|
||||
#define HDP_BASE__INST4_SEG3 0
|
||||
#define HDP_BASE__INST4_SEG4 0
|
||||
#define HDP_BASE__INST4_SEG5 0
|
||||
|
||||
#define HDP_BASE__INST5_SEG0 0
|
||||
#define HDP_BASE__INST5_SEG1 0
|
||||
#define HDP_BASE__INST5_SEG2 0
|
||||
#define HDP_BASE__INST5_SEG3 0
|
||||
#define HDP_BASE__INST5_SEG4 0
|
||||
#define HDP_BASE__INST5_SEG5 0
|
||||
|
||||
#define MMHUB_BASE__INST0_SEG0 0x0001A000
|
||||
#define MMHUB_BASE__INST0_SEG1 0
|
||||
#define MMHUB_BASE__INST0_SEG2 0
|
||||
#define MMHUB_BASE__INST0_SEG3 0
|
||||
#define MMHUB_BASE__INST0_SEG4 0
|
||||
#define MMHUB_BASE__INST0_SEG5 0
|
||||
|
||||
#define MMHUB_BASE__INST1_SEG0 0
|
||||
#define MMHUB_BASE__INST1_SEG1 0
|
||||
#define MMHUB_BASE__INST1_SEG2 0
|
||||
#define MMHUB_BASE__INST1_SEG3 0
|
||||
#define MMHUB_BASE__INST1_SEG4 0
|
||||
#define MMHUB_BASE__INST1_SEG5 0
|
||||
|
||||
#define MMHUB_BASE__INST2_SEG0 0
|
||||
#define MMHUB_BASE__INST2_SEG1 0
|
||||
#define MMHUB_BASE__INST2_SEG2 0
|
||||
#define MMHUB_BASE__INST2_SEG3 0
|
||||
#define MMHUB_BASE__INST2_SEG4 0
|
||||
#define MMHUB_BASE__INST2_SEG5 0
|
||||
|
||||
#define MMHUB_BASE__INST3_SEG0 0
|
||||
#define MMHUB_BASE__INST3_SEG1 0
|
||||
#define MMHUB_BASE__INST3_SEG2 0
|
||||
#define MMHUB_BASE__INST3_SEG3 0
|
||||
#define MMHUB_BASE__INST3_SEG4 0
|
||||
#define MMHUB_BASE__INST3_SEG5 0
|
||||
|
||||
#define MMHUB_BASE__INST4_SEG0 0
|
||||
#define MMHUB_BASE__INST4_SEG1 0
|
||||
#define MMHUB_BASE__INST4_SEG2 0
|
||||
#define MMHUB_BASE__INST4_SEG3 0
|
||||
#define MMHUB_BASE__INST4_SEG4 0
|
||||
#define MMHUB_BASE__INST4_SEG5 0
|
||||
|
||||
#define MMHUB_BASE__INST5_SEG0 0
|
||||
#define MMHUB_BASE__INST5_SEG1 0
|
||||
#define MMHUB_BASE__INST5_SEG2 0
|
||||
#define MMHUB_BASE__INST5_SEG3 0
|
||||
#define MMHUB_BASE__INST5_SEG4 0
|
||||
#define MMHUB_BASE__INST5_SEG5 0
|
||||
|
||||
#define MP0_BASE__INST0_SEG0 0x00016000
|
||||
#define MP0_BASE__INST0_SEG1 0
|
||||
#define MP0_BASE__INST0_SEG2 0
|
||||
#define MP0_BASE__INST0_SEG3 0
|
||||
#define MP0_BASE__INST0_SEG4 0
|
||||
#define MP0_BASE__INST0_SEG5 0
|
||||
|
||||
#define MP0_BASE__INST1_SEG0 0
|
||||
#define MP0_BASE__INST1_SEG1 0
|
||||
#define MP0_BASE__INST1_SEG2 0
|
||||
#define MP0_BASE__INST1_SEG3 0
|
||||
#define MP0_BASE__INST1_SEG4 0
|
||||
#define MP0_BASE__INST1_SEG5 0
|
||||
|
||||
#define MP0_BASE__INST2_SEG0 0
|
||||
#define MP0_BASE__INST2_SEG1 0
|
||||
#define MP0_BASE__INST2_SEG2 0
|
||||
#define MP0_BASE__INST2_SEG3 0
|
||||
#define MP0_BASE__INST2_SEG4 0
|
||||
#define MP0_BASE__INST2_SEG5 0
|
||||
|
||||
#define MP0_BASE__INST3_SEG0 0
|
||||
#define MP0_BASE__INST3_SEG1 0
|
||||
#define MP0_BASE__INST3_SEG2 0
|
||||
#define MP0_BASE__INST3_SEG3 0
|
||||
#define MP0_BASE__INST3_SEG4 0
|
||||
#define MP0_BASE__INST3_SEG5 0
|
||||
|
||||
#define MP0_BASE__INST4_SEG0 0
|
||||
#define MP0_BASE__INST4_SEG1 0
|
||||
#define MP0_BASE__INST4_SEG2 0
|
||||
#define MP0_BASE__INST4_SEG3 0
|
||||
#define MP0_BASE__INST4_SEG4 0
|
||||
#define MP0_BASE__INST4_SEG5 0
|
||||
|
||||
#define MP0_BASE__INST5_SEG0 0
|
||||
#define MP0_BASE__INST5_SEG1 0
|
||||
#define MP0_BASE__INST5_SEG2 0
|
||||
#define MP0_BASE__INST5_SEG3 0
|
||||
#define MP0_BASE__INST5_SEG4 0
|
||||
#define MP0_BASE__INST5_SEG5 0
|
||||
|
||||
#define MP1_BASE__INST0_SEG0 0x00016000
|
||||
#define MP1_BASE__INST0_SEG1 0
|
||||
#define MP1_BASE__INST0_SEG2 0
|
||||
#define MP1_BASE__INST0_SEG3 0
|
||||
#define MP1_BASE__INST0_SEG4 0
|
||||
#define MP1_BASE__INST0_SEG5 0
|
||||
|
||||
#define MP1_BASE__INST1_SEG0 0
|
||||
#define MP1_BASE__INST1_SEG1 0
|
||||
#define MP1_BASE__INST1_SEG2 0
|
||||
#define MP1_BASE__INST1_SEG3 0
|
||||
#define MP1_BASE__INST1_SEG4 0
|
||||
#define MP1_BASE__INST1_SEG5 0
|
||||
|
||||
#define MP1_BASE__INST2_SEG0 0
|
||||
#define MP1_BASE__INST2_SEG1 0
|
||||
#define MP1_BASE__INST2_SEG2 0
|
||||
#define MP1_BASE__INST2_SEG3 0
|
||||
#define MP1_BASE__INST2_SEG4 0
|
||||
#define MP1_BASE__INST2_SEG5 0
|
||||
|
||||
#define MP1_BASE__INST3_SEG0 0
|
||||
#define MP1_BASE__INST3_SEG1 0
|
||||
#define MP1_BASE__INST3_SEG2 0
|
||||
#define MP1_BASE__INST3_SEG3 0
|
||||
#define MP1_BASE__INST3_SEG4 0
|
||||
#define MP1_BASE__INST3_SEG5 0
|
||||
|
||||
#define MP1_BASE__INST4_SEG0 0
|
||||
#define MP1_BASE__INST4_SEG1 0
|
||||
#define MP1_BASE__INST4_SEG2 0
|
||||
#define MP1_BASE__INST4_SEG3 0
|
||||
#define MP1_BASE__INST4_SEG4 0
|
||||
#define MP1_BASE__INST4_SEG5 0
|
||||
|
||||
#define MP1_BASE__INST5_SEG0 0
|
||||
#define MP1_BASE__INST5_SEG1 0
|
||||
#define MP1_BASE__INST5_SEG2 0
|
||||
#define MP1_BASE__INST5_SEG3 0
|
||||
#define MP1_BASE__INST5_SEG4 0
|
||||
#define MP1_BASE__INST5_SEG5 0
|
||||
|
||||
#define NBIO_BASE__INST0_SEG0 0x00000000
|
||||
#define NBIO_BASE__INST0_SEG1 0x00000014
|
||||
#define NBIO_BASE__INST0_SEG2 0x00000D20
|
||||
#define NBIO_BASE__INST0_SEG3 0x00010400
|
||||
#define NBIO_BASE__INST0_SEG4 0
|
||||
#define NBIO_BASE__INST0_SEG5 0
|
||||
|
||||
#define NBIO_BASE__INST1_SEG0 0
|
||||
#define NBIO_BASE__INST1_SEG1 0
|
||||
#define NBIO_BASE__INST1_SEG2 0
|
||||
#define NBIO_BASE__INST1_SEG3 0
|
||||
#define NBIO_BASE__INST1_SEG4 0
|
||||
#define NBIO_BASE__INST1_SEG5 0
|
||||
|
||||
#define NBIO_BASE__INST2_SEG0 0
|
||||
#define NBIO_BASE__INST2_SEG1 0
|
||||
#define NBIO_BASE__INST2_SEG2 0
|
||||
#define NBIO_BASE__INST2_SEG3 0
|
||||
#define NBIO_BASE__INST2_SEG4 0
|
||||
#define NBIO_BASE__INST2_SEG5 0
|
||||
|
||||
#define NBIO_BASE__INST3_SEG0 0
|
||||
#define NBIO_BASE__INST3_SEG1 0
|
||||
#define NBIO_BASE__INST3_SEG2 0
|
||||
#define NBIO_BASE__INST3_SEG3 0
|
||||
#define NBIO_BASE__INST3_SEG4 0
|
||||
#define NBIO_BASE__INST3_SEG5 0
|
||||
|
||||
#define NBIO_BASE__INST4_SEG0 0
|
||||
#define NBIO_BASE__INST4_SEG1 0
|
||||
#define NBIO_BASE__INST4_SEG2 0
|
||||
#define NBIO_BASE__INST4_SEG3 0
|
||||
#define NBIO_BASE__INST4_SEG4 0
|
||||
#define NBIO_BASE__INST4_SEG5 0
|
||||
|
||||
#define NBIO_BASE__INST5_SEG0 0
|
||||
#define NBIO_BASE__INST5_SEG1 0
|
||||
#define NBIO_BASE__INST5_SEG2 0
|
||||
#define NBIO_BASE__INST5_SEG3 0
|
||||
#define NBIO_BASE__INST5_SEG4 0
|
||||
#define NBIO_BASE__INST5_SEG5 0
|
||||
|
||||
#define OSSSYS_BASE__INST0_SEG0 0x000010A0
|
||||
#define OSSSYS_BASE__INST0_SEG1 0
|
||||
#define OSSSYS_BASE__INST0_SEG2 0
|
||||
#define OSSSYS_BASE__INST0_SEG3 0
|
||||
#define OSSSYS_BASE__INST0_SEG4 0
|
||||
#define OSSSYS_BASE__INST0_SEG5 0
|
||||
|
||||
#define OSSSYS_BASE__INST1_SEG0 0
|
||||
#define OSSSYS_BASE__INST1_SEG1 0
|
||||
#define OSSSYS_BASE__INST1_SEG2 0
|
||||
#define OSSSYS_BASE__INST1_SEG3 0
|
||||
#define OSSSYS_BASE__INST1_SEG4 0
|
||||
#define OSSSYS_BASE__INST1_SEG5 0
|
||||
|
||||
#define OSSSYS_BASE__INST2_SEG0 0
|
||||
#define OSSSYS_BASE__INST2_SEG1 0
|
||||
#define OSSSYS_BASE__INST2_SEG2 0
|
||||
#define OSSSYS_BASE__INST2_SEG3 0
|
||||
#define OSSSYS_BASE__INST2_SEG4 0
|
||||
#define OSSSYS_BASE__INST2_SEG5 0
|
||||
|
||||
#define OSSSYS_BASE__INST3_SEG0 0
|
||||
#define OSSSYS_BASE__INST3_SEG1 0
|
||||
#define OSSSYS_BASE__INST3_SEG2 0
|
||||
#define OSSSYS_BASE__INST3_SEG3 0
|
||||
#define OSSSYS_BASE__INST3_SEG4 0
|
||||
#define OSSSYS_BASE__INST3_SEG5 0
|
||||
|
||||
#define OSSSYS_BASE__INST4_SEG0 0
|
||||
#define OSSSYS_BASE__INST4_SEG1 0
|
||||
#define OSSSYS_BASE__INST4_SEG2 0
|
||||
#define OSSSYS_BASE__INST4_SEG3 0
|
||||
#define OSSSYS_BASE__INST4_SEG4 0
|
||||
#define OSSSYS_BASE__INST4_SEG5 0
|
||||
|
||||
#define OSSSYS_BASE__INST5_SEG0 0
|
||||
#define OSSSYS_BASE__INST5_SEG1 0
|
||||
#define OSSSYS_BASE__INST5_SEG2 0
|
||||
#define OSSSYS_BASE__INST5_SEG3 0
|
||||
#define OSSSYS_BASE__INST5_SEG4 0
|
||||
#define OSSSYS_BASE__INST5_SEG5 0
|
||||
|
||||
#define RSMU_BASE__INST0_SEG0 0x00012000
|
||||
#define RSMU_BASE__INST0_SEG1 0
|
||||
#define RSMU_BASE__INST0_SEG2 0
|
||||
#define RSMU_BASE__INST0_SEG3 0
|
||||
#define RSMU_BASE__INST0_SEG4 0
|
||||
#define RSMU_BASE__INST0_SEG5 0
|
||||
|
||||
#define RSMU_BASE__INST1_SEG0 0
|
||||
#define RSMU_BASE__INST1_SEG1 0
|
||||
#define RSMU_BASE__INST1_SEG2 0
|
||||
#define RSMU_BASE__INST1_SEG3 0
|
||||
#define RSMU_BASE__INST1_SEG4 0
|
||||
#define RSMU_BASE__INST1_SEG5 0
|
||||
|
||||
#define RSMU_BASE__INST2_SEG0 0
|
||||
#define RSMU_BASE__INST2_SEG1 0
|
||||
#define RSMU_BASE__INST2_SEG2 0
|
||||
#define RSMU_BASE__INST2_SEG3 0
|
||||
#define RSMU_BASE__INST2_SEG4 0
|
||||
#define RSMU_BASE__INST2_SEG5 0
|
||||
|
||||
#define RSMU_BASE__INST3_SEG0 0
|
||||
#define RSMU_BASE__INST3_SEG1 0
|
||||
#define RSMU_BASE__INST3_SEG2 0
|
||||
#define RSMU_BASE__INST3_SEG3 0
|
||||
#define RSMU_BASE__INST3_SEG4 0
|
||||
#define RSMU_BASE__INST3_SEG5 0
|
||||
|
||||
#define RSMU_BASE__INST4_SEG0 0
|
||||
#define RSMU_BASE__INST4_SEG1 0
|
||||
#define RSMU_BASE__INST4_SEG2 0
|
||||
#define RSMU_BASE__INST4_SEG3 0
|
||||
#define RSMU_BASE__INST4_SEG4 0
|
||||
#define RSMU_BASE__INST4_SEG5 0
|
||||
|
||||
#define RSMU_BASE__INST5_SEG0 0
|
||||
#define RSMU_BASE__INST5_SEG1 0
|
||||
#define RSMU_BASE__INST5_SEG2 0
|
||||
#define RSMU_BASE__INST5_SEG3 0
|
||||
#define RSMU_BASE__INST5_SEG4 0
|
||||
#define RSMU_BASE__INST5_SEG5 0
|
||||
|
||||
#define SMUIO_BASE__INST0_SEG0 0x00016800
|
||||
#define SMUIO_BASE__INST0_SEG1 0x00016A00
|
||||
#define SMUIO_BASE__INST0_SEG2 0
|
||||
#define SMUIO_BASE__INST0_SEG3 0
|
||||
#define SMUIO_BASE__INST0_SEG4 0
|
||||
#define SMUIO_BASE__INST0_SEG5 0
|
||||
|
||||
#define SMUIO_BASE__INST1_SEG0 0
|
||||
#define SMUIO_BASE__INST1_SEG1 0
|
||||
#define SMUIO_BASE__INST1_SEG2 0
|
||||
#define SMUIO_BASE__INST1_SEG3 0
|
||||
#define SMUIO_BASE__INST1_SEG4 0
|
||||
#define SMUIO_BASE__INST1_SEG5 0
|
||||
|
||||
#define SMUIO_BASE__INST2_SEG0 0
|
||||
#define SMUIO_BASE__INST2_SEG1 0
|
||||
#define SMUIO_BASE__INST2_SEG2 0
|
||||
#define SMUIO_BASE__INST2_SEG3 0
|
||||
#define SMUIO_BASE__INST2_SEG4 0
|
||||
#define SMUIO_BASE__INST2_SEG5 0
|
||||
|
||||
#define SMUIO_BASE__INST3_SEG0 0
|
||||
#define SMUIO_BASE__INST3_SEG1 0
|
||||
#define SMUIO_BASE__INST3_SEG2 0
|
||||
#define SMUIO_BASE__INST3_SEG3 0
|
||||
#define SMUIO_BASE__INST3_SEG4 0
|
||||
#define SMUIO_BASE__INST3_SEG5 0
|
||||
|
||||
#define SMUIO_BASE__INST4_SEG0 0
|
||||
#define SMUIO_BASE__INST4_SEG1 0
|
||||
#define SMUIO_BASE__INST4_SEG2 0
|
||||
#define SMUIO_BASE__INST4_SEG3 0
|
||||
#define SMUIO_BASE__INST4_SEG4 0
|
||||
#define SMUIO_BASE__INST4_SEG5 0
|
||||
|
||||
#define SMUIO_BASE__INST5_SEG0 0
|
||||
#define SMUIO_BASE__INST5_SEG1 0
|
||||
#define SMUIO_BASE__INST5_SEG2 0
|
||||
#define SMUIO_BASE__INST5_SEG3 0
|
||||
#define SMUIO_BASE__INST5_SEG4 0
|
||||
#define SMUIO_BASE__INST5_SEG5 0
|
||||
|
||||
#define THM_BASE__INST0_SEG0 0x00016600
|
||||
#define THM_BASE__INST0_SEG1 0
|
||||
#define THM_BASE__INST0_SEG2 0
|
||||
#define THM_BASE__INST0_SEG3 0
|
||||
#define THM_BASE__INST0_SEG4 0
|
||||
#define THM_BASE__INST0_SEG5 0
|
||||
|
||||
#define THM_BASE__INST1_SEG0 0
|
||||
#define THM_BASE__INST1_SEG1 0
|
||||
#define THM_BASE__INST1_SEG2 0
|
||||
#define THM_BASE__INST1_SEG3 0
|
||||
#define THM_BASE__INST1_SEG4 0
|
||||
#define THM_BASE__INST1_SEG5 0
|
||||
|
||||
#define THM_BASE__INST2_SEG0 0
|
||||
#define THM_BASE__INST2_SEG1 0
|
||||
#define THM_BASE__INST2_SEG2 0
|
||||
#define THM_BASE__INST2_SEG3 0
|
||||
#define THM_BASE__INST2_SEG4 0
|
||||
#define THM_BASE__INST2_SEG5 0
|
||||
|
||||
#define THM_BASE__INST3_SEG0 0
|
||||
#define THM_BASE__INST3_SEG1 0
|
||||
#define THM_BASE__INST3_SEG2 0
|
||||
#define THM_BASE__INST3_SEG3 0
|
||||
#define THM_BASE__INST3_SEG4 0
|
||||
#define THM_BASE__INST3_SEG5 0
|
||||
|
||||
#define THM_BASE__INST4_SEG0 0
|
||||
#define THM_BASE__INST4_SEG1 0
|
||||
#define THM_BASE__INST4_SEG2 0
|
||||
#define THM_BASE__INST4_SEG3 0
|
||||
#define THM_BASE__INST4_SEG4 0
|
||||
#define THM_BASE__INST4_SEG5 0
|
||||
|
||||
#define THM_BASE__INST5_SEG0 0
|
||||
#define THM_BASE__INST5_SEG1 0
|
||||
#define THM_BASE__INST5_SEG2 0
|
||||
#define THM_BASE__INST5_SEG3 0
|
||||
#define THM_BASE__INST5_SEG4 0
|
||||
#define THM_BASE__INST5_SEG5 0
|
||||
|
||||
#define UMC_BASE__INST0_SEG0 0x00014000
|
||||
#define UMC_BASE__INST0_SEG1 0
|
||||
#define UMC_BASE__INST0_SEG2 0
|
||||
#define UMC_BASE__INST0_SEG3 0
|
||||
#define UMC_BASE__INST0_SEG4 0
|
||||
#define UMC_BASE__INST0_SEG5 0
|
||||
|
||||
#define UMC_BASE__INST1_SEG0 0
|
||||
#define UMC_BASE__INST1_SEG1 0
|
||||
#define UMC_BASE__INST1_SEG2 0
|
||||
#define UMC_BASE__INST1_SEG3 0
|
||||
#define UMC_BASE__INST1_SEG4 0
|
||||
#define UMC_BASE__INST1_SEG5 0
|
||||
|
||||
#define UMC_BASE__INST2_SEG0 0
|
||||
#define UMC_BASE__INST2_SEG1 0
|
||||
#define UMC_BASE__INST2_SEG2 0
|
||||
#define UMC_BASE__INST2_SEG3 0
|
||||
#define UMC_BASE__INST2_SEG4 0
|
||||
#define UMC_BASE__INST2_SEG5 0
|
||||
|
||||
#define UMC_BASE__INST3_SEG0 0
|
||||
#define UMC_BASE__INST3_SEG1 0
|
||||
#define UMC_BASE__INST3_SEG2 0
|
||||
#define UMC_BASE__INST3_SEG3 0
|
||||
#define UMC_BASE__INST3_SEG4 0
|
||||
#define UMC_BASE__INST3_SEG5 0
|
||||
|
||||
#define UMC_BASE__INST4_SEG0 0
|
||||
#define UMC_BASE__INST4_SEG1 0
|
||||
#define UMC_BASE__INST4_SEG2 0
|
||||
#define UMC_BASE__INST4_SEG3 0
|
||||
#define UMC_BASE__INST4_SEG4 0
|
||||
#define UMC_BASE__INST4_SEG5 0
|
||||
|
||||
#define UMC_BASE__INST5_SEG0 0
|
||||
#define UMC_BASE__INST5_SEG1 0
|
||||
#define UMC_BASE__INST5_SEG2 0
|
||||
#define UMC_BASE__INST5_SEG3 0
|
||||
#define UMC_BASE__INST5_SEG4 0
|
||||
#define UMC_BASE__INST5_SEG5 0
|
||||
|
||||
#define VCN_BASE__INST0_SEG0 0x00007800
|
||||
#define VCN_BASE__INST0_SEG1 0x00007E00
|
||||
#define VCN_BASE__INST0_SEG2 0
|
||||
#define VCN_BASE__INST0_SEG3 0
|
||||
#define VCN_BASE__INST0_SEG4 0
|
||||
#define VCN_BASE__INST0_SEG5 0
|
||||
|
||||
#define VCN_BASE__INST1_SEG0 0
|
||||
#define VCN_BASE__INST1_SEG1 0
|
||||
#define VCN_BASE__INST1_SEG2 0
|
||||
#define VCN_BASE__INST1_SEG3 0
|
||||
#define VCN_BASE__INST1_SEG4 0
|
||||
#define VCN_BASE__INST1_SEG5 0
|
||||
|
||||
#define VCN_BASE__INST2_SEG0 0
|
||||
#define VCN_BASE__INST2_SEG1 0
|
||||
#define VCN_BASE__INST2_SEG2 0
|
||||
#define VCN_BASE__INST2_SEG3 0
|
||||
#define VCN_BASE__INST2_SEG4 0
|
||||
#define VCN_BASE__INST2_SEG5 0
|
||||
|
||||
#define VCN_BASE__INST3_SEG0 0
|
||||
#define VCN_BASE__INST3_SEG1 0
|
||||
#define VCN_BASE__INST3_SEG2 0
|
||||
#define VCN_BASE__INST3_SEG3 0
|
||||
#define VCN_BASE__INST3_SEG4 0
|
||||
#define VCN_BASE__INST3_SEG5 0
|
||||
|
||||
#define VCN_BASE__INST4_SEG0 0
|
||||
#define VCN_BASE__INST4_SEG1 0
|
||||
#define VCN_BASE__INST4_SEG2 0
|
||||
#define VCN_BASE__INST4_SEG3 0
|
||||
#define VCN_BASE__INST4_SEG4 0
|
||||
#define VCN_BASE__INST4_SEG5 0
|
||||
|
||||
#define VCN_BASE__INST5_SEG0 0
|
||||
#define VCN_BASE__INST5_SEG1 0
|
||||
#define VCN_BASE__INST5_SEG2 0
|
||||
#define VCN_BASE__INST5_SEG3 0
|
||||
#define VCN_BASE__INST5_SEG4 0
|
||||
#define VCN_BASE__INST5_SEG5 0
|
||||
|
||||
#endif
|
|
@ -93,6 +93,8 @@
|
|||
#define SATA_HWID 168
|
||||
#define USB_HWID 170
|
||||
#define CCXSEC_HWID 176
|
||||
#define XGMI_HWID 200
|
||||
#define XGBE_HWID 216
|
||||
#define MP0_HWID 254
|
||||
#define MP0_HWID 255
|
||||
|
||||
#endif
|
||||
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