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ARM: dts: imx6ul: add TQ-Systems MBa6ULxL device trees
Add device trees for the MBa6ULx mainboard with TQMa6ULxL SoMs. Signed-off-by: Alexander Stein <alexander.stein@ew.tq-group.com> Signed-off-by: Shawn Guo <shawnguo@kernel.org>
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a333f3e46d
4 changed files with 135 additions and 0 deletions
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@ -692,6 +692,7 @@ dtb-$(CONFIG_SOC_IMX6UL) += \
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imx6ul-liteboard.dtb \
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imx6ul-liteboard.dtb \
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imx6ul-tqma6ul1-mba6ulx.dtb \
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imx6ul-tqma6ul1-mba6ulx.dtb \
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||||||
imx6ul-tqma6ul2-mba6ulx.dtb \
|
imx6ul-tqma6ul2-mba6ulx.dtb \
|
||||||
|
imx6ul-tqma6ul2l-mba6ulx.dtb \
|
||||||
imx6ul-opos6uldev.dtb \
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imx6ul-opos6uldev.dtb \
|
||||||
imx6ul-pico-dwarf.dtb \
|
imx6ul-pico-dwarf.dtb \
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||||||
imx6ul-pico-hobbit.dtb \
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imx6ul-pico-hobbit.dtb \
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||||||
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15
arch/arm/boot/dts/imx6ul-tqma6ul2l-mba6ulx.dts
Normal file
15
arch/arm/boot/dts/imx6ul-tqma6ul2l-mba6ulx.dts
Normal file
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@ -0,0 +1,15 @@
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||||||
|
// SPDX-License-Identifier: (GPL-2.0-or-later OR MIT)
|
||||||
|
/*
|
||||||
|
* Copyright 2018-2022 TQ Systems GmbH
|
||||||
|
* Author: Markus Niebel <Markus.Niebel@tq-group.com>
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*/
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||||||
|
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||||||
|
/dts-v1/;
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||||||
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||||||
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#include "imx6ul-tqma6ul2l.dtsi"
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|
#include "mba6ulx.dtsi"
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/ {
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||||||
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model = "TQ Systems TQMa6UL2L SoM on MBa6ULx board";
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||||||
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compatible = "tq,imx6ul-tqma6ul2l-mba6ulx", "tq,imx6ul-tqma6ul2l", "fsl,imx6ul";
|
||||||
|
};
|
71
arch/arm/boot/dts/imx6ul-tqma6ul2l.dtsi
Normal file
71
arch/arm/boot/dts/imx6ul-tqma6ul2l.dtsi
Normal file
|
@ -0,0 +1,71 @@
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||||||
|
// SPDX-License-Identifier: (GPL-2.0-or-later OR MIT)
|
||||||
|
/*
|
||||||
|
* Copyright 2018-2022 TQ-Systems GmbH
|
||||||
|
* Author: Markus Niebel <Markus.Niebel@tq-group.com>
|
||||||
|
*/
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||||||
|
|
||||||
|
#include "imx6ul.dtsi"
|
||||||
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#include "imx6ul-tqma6ul-common.dtsi"
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#include "imx6ul-tqma6ulxl-common.dtsi"
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||||||
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|
||||||
|
/ {
|
||||||
|
model = "TQ-Systems TQMa6UL2L SoM";
|
||||||
|
compatible = "tq,imx6ul-tqma6ul2l", "fsl,imx6ul";
|
||||||
|
};
|
||||||
|
|
||||||
|
&usdhc2 {
|
||||||
|
fsl,tuning-step= <6>;
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||||||
|
};
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||||||
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|
&iomuxc {
|
||||||
|
pinctrl_usdhc2: usdhc2grp {
|
||||||
|
fsl,pins = <
|
||||||
|
MX6UL_PAD_NAND_RE_B__USDHC2_CLK 0x00017051
|
||||||
|
MX6UL_PAD_NAND_WE_B__USDHC2_CMD 0x00017051
|
||||||
|
MX6UL_PAD_NAND_DATA00__USDHC2_DATA0 0x00017051
|
||||||
|
MX6UL_PAD_NAND_DATA01__USDHC2_DATA1 0x00017051
|
||||||
|
MX6UL_PAD_NAND_DATA02__USDHC2_DATA2 0x00017051
|
||||||
|
MX6UL_PAD_NAND_DATA03__USDHC2_DATA3 0x00017051
|
||||||
|
MX6UL_PAD_NAND_DATA04__USDHC2_DATA4 0x00017051
|
||||||
|
MX6UL_PAD_NAND_DATA05__USDHC2_DATA5 0x00017051
|
||||||
|
MX6UL_PAD_NAND_DATA06__USDHC2_DATA6 0x00017051
|
||||||
|
MX6UL_PAD_NAND_DATA07__USDHC2_DATA7 0x00017051
|
||||||
|
/* rst */
|
||||||
|
MX6UL_PAD_NAND_ALE__GPIO4_IO10 0x0001b051
|
||||||
|
>;
|
||||||
|
};
|
||||||
|
|
||||||
|
pinctrl_usdhc2_100mhz: usdhc2-100mhzgrp {
|
||||||
|
fsl,pins = <
|
||||||
|
MX6UL_PAD_NAND_RE_B__USDHC2_CLK 0x000170e1
|
||||||
|
MX6UL_PAD_NAND_WE_B__USDHC2_CMD 0x000170f1
|
||||||
|
MX6UL_PAD_NAND_DATA00__USDHC2_DATA0 0x000170f1
|
||||||
|
MX6UL_PAD_NAND_DATA01__USDHC2_DATA1 0x000170f1
|
||||||
|
MX6UL_PAD_NAND_DATA02__USDHC2_DATA2 0x000170f1
|
||||||
|
MX6UL_PAD_NAND_DATA03__USDHC2_DATA3 0x000170f1
|
||||||
|
MX6UL_PAD_NAND_DATA04__USDHC2_DATA4 0x000170f1
|
||||||
|
MX6UL_PAD_NAND_DATA05__USDHC2_DATA5 0x000170f1
|
||||||
|
MX6UL_PAD_NAND_DATA06__USDHC2_DATA6 0x000170f1
|
||||||
|
MX6UL_PAD_NAND_DATA07__USDHC2_DATA7 0x000170f1
|
||||||
|
/* rst */
|
||||||
|
MX6UL_PAD_NAND_ALE__GPIO4_IO10 0x0001b051
|
||||||
|
>;
|
||||||
|
};
|
||||||
|
|
||||||
|
pinctrl_usdhc2_200mhz: usdhc2-200mhzgrp {
|
||||||
|
fsl,pins = <
|
||||||
|
MX6UL_PAD_NAND_RE_B__USDHC2_CLK 0x000170f9
|
||||||
|
MX6UL_PAD_NAND_WE_B__USDHC2_CMD 0x000170f1
|
||||||
|
MX6UL_PAD_NAND_DATA00__USDHC2_DATA0 0x000170f1
|
||||||
|
MX6UL_PAD_NAND_DATA01__USDHC2_DATA1 0x000170f1
|
||||||
|
MX6UL_PAD_NAND_DATA02__USDHC2_DATA2 0x000170f1
|
||||||
|
MX6UL_PAD_NAND_DATA03__USDHC2_DATA3 0x000170f1
|
||||||
|
MX6UL_PAD_NAND_DATA04__USDHC2_DATA4 0x000170f1
|
||||||
|
MX6UL_PAD_NAND_DATA05__USDHC2_DATA5 0x000170f1
|
||||||
|
MX6UL_PAD_NAND_DATA06__USDHC2_DATA6 0x000170f1
|
||||||
|
MX6UL_PAD_NAND_DATA07__USDHC2_DATA7 0x000170f1
|
||||||
|
/* rst */
|
||||||
|
MX6UL_PAD_NAND_ALE__GPIO4_IO10 0x0001b051
|
||||||
|
>;
|
||||||
|
};
|
||||||
|
};
|
48
arch/arm/boot/dts/imx6ul-tqma6ulxl-common.dtsi
Normal file
48
arch/arm/boot/dts/imx6ul-tqma6ulxl-common.dtsi
Normal file
|
@ -0,0 +1,48 @@
|
||||||
|
// SPDX-License-Identifier: (GPL-2.0-or-later OR MIT)
|
||||||
|
/*
|
||||||
|
* Copyright 2018-2022 TQ-Systems GmbH
|
||||||
|
* Author: Markus Niebel <Markus.Niebel@tq-group.com>
|
||||||
|
*/
|
||||||
|
|
||||||
|
/*
|
||||||
|
* Common for
|
||||||
|
* - TQMa6ULxL
|
||||||
|
* - TQMa6ULLxL
|
||||||
|
*/
|
||||||
|
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||||||
|
/ {
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||||||
|
reg_vin: reg-vin {
|
||||||
|
compatible = "regulator-fixed";
|
||||||
|
regulator-name = "VIN";
|
||||||
|
regulator-min-microvolt = <3300000>;
|
||||||
|
regulator-max-microvolt = <3300000>;
|
||||||
|
regulator-always-on;
|
||||||
|
};
|
||||||
|
};
|
||||||
|
|
||||||
|
&m24c64_50 {
|
||||||
|
vcc-supply = <®_vin>;
|
||||||
|
};
|
||||||
|
|
||||||
|
&m24c02_52 {
|
||||||
|
vcc-supply = <®_vin>;
|
||||||
|
};
|
||||||
|
|
||||||
|
/* eMMC */
|
||||||
|
&usdhc2 {
|
||||||
|
vmmc-supply = <®_vin>;
|
||||||
|
vqmmc-supply = <®_vldo4>;
|
||||||
|
};
|
||||||
|
|
||||||
|
&iomuxc {
|
||||||
|
pinctrl_qspi: qspigrp {
|
||||||
|
fsl,pins = <
|
||||||
|
MX6UL_PAD_NAND_WP_B__QSPI_A_SCLK 0x70a9
|
||||||
|
MX6UL_PAD_NAND_READY_B__QSPI_A_DATA00 0x70a9
|
||||||
|
MX6UL_PAD_NAND_CE0_B__QSPI_A_DATA01 0x70a9
|
||||||
|
MX6UL_PAD_NAND_CE1_B__QSPI_A_DATA02 0x70a9
|
||||||
|
MX6UL_PAD_NAND_CLE__QSPI_A_DATA03 0x70a9
|
||||||
|
MX6UL_PAD_NAND_DQS__QSPI_A_SS0_B 0x70a1
|
||||||
|
>;
|
||||||
|
};
|
||||||
|
};
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